数字逻辑与集成电路设计(电子科技大学) 中国大学mooc慕课答案2024版 m37209

1.课程概要 第一章单元测验

1、 十进制数 38.75 对应的8421BCD码是：

答案: 00111000.01110101

2、 二进制数 101111.0111 对应的八进制数是：

答案: 57.34

3、 In a system with even parity communication, if information bits are (10010011)2, its even parity bit is ( )?

答案: 0

4、 Number A and B are 8-bit integer. Given a decimal number A=-67, the one’s complement code of number B=10001001, then the two’s complement code of A+B= ( ), overflow?(YES/NO) ( )

答案: 01000111YES

5、 上图逻辑单元实现的功能为

答案:  y=(a+b).(c+d) 

6、 若CMOS单元的设计指标为：输入高电平最小值 2.8V 输入低电平最大值 2.3V输出高电平最小值 3.9V 输出低电平最大值 0.7V则低电平噪声容限为

答案: 1.6V

7、 一个8位的无符号数系统表示0-255共256个数，把一个圆匀均分成256个刻度，从00000000开始，按照顺时针顺序，下一个刻度为00000001，再下一个刻度为00000010，以此类推。有一条小狗在圆上跑步，它从01000000开始，经过2020个刻度后，此时小狗在圆上的哪个位置？

答案: 00100100

8、 下图逻辑单元实现的功能为

答案:  y=(a.(b+c))’ 

9、 The arithmetic operation 105=44+31 is correct in one number system. The possible radix of the numbers in the equation is ( ).

答案: 7

10、 The parameters of CMOS device D1 are: VOHmax=3.84V, VOLmax=0.33V, VIHmax=1.8V, VILmax=0.9V, IOH(max)=-4mA，IOL(max)=4mA, IIH=1uA, IIL=-1uA. The parameters of CMOS device D2 are: VOHmax=2.8V, VOLmax=0.4V, VIHmax=2.0V, VILmax=0.8V, IOL(max)=8mA, IOH(max)=-400uA, IIL=-0.4mA, IIH=20uA. If device D1 drives device D2, the LOW-state DC noise margin and the fan-out is（ ）

答案: 0.47V, 10

11、 二进制加法运算包含的输入、输出变量有：

答案: 进位输入: C in;
进位输出: C out ;
本位和: S

12、 一个CMOS器件由4个MOS器件构成，它可能是

答案:  NAND2 ;
BUFFER

13、 关于CMOS数字集成电路中的功耗，下列说法哪些是正确的

答案: 与单位时间内的状态变化次数正比;
主要为动态功耗;
与发生状态变化的电容总量正比;
与电源电压的平方成正比

14、 CMOS反相器电压转移特性如图所示下列说法中哪些是正确的

答案: 输入高电平最小值约为3.2V;
输出低电平范围约为0–0.3V;
输入低电平范围约为0–1.8V

15、 Which of the following four unsigned numbers is the minimum one?

答案:  (151)16 ;
(0011 0011 1101)2421 

16、 十进制数的-25，以下说法正确的是

答案: 6位反码是100110;
8位补码是11100111;
在5位有符号数系统中不存在

17、 在CMOS结构中，当2个输入控制的PMOS器件构成串联时，这2个变量进行与运算；

答案: 错误
分析：PMOS串联，则NMOS 必然并联，此时这两个变量进行或非运算

18、 连接有上拉电阻的漏极开路门单元的可能输出状态为高阻态、低电平状态和高电平状态。

答案: 错误
分析：接了上拉电阻的漏极开路门没有高阻态。

19、 2个独立的CMOS单元的输出不能进行相互连接

答案: 正确

20、 2421码中的7为0111

答案: 错误
分析：2421码的0~4为0000~0100，5-9是4~0自反码，所以7应该是2的自反码，应该为1101

2.数字逻辑电路设计基础 第二章单元测验

1、 在四变量卡诺图中，逻辑上不相邻的一组最小项为（）。

答案: m2与 m8

2、 L=AB+C的对偶式为（）。

答案: （A+B）C

3、 属于组合逻辑电路的部件是（）。

答案: 译码器

4、 已知二变量输入逻辑门的输入A、B和输出F的波形如图所示，这必定是 逻辑门的波形

答案: 无法判断

5、 下列表达式中存在静态1冒险的有（ ）。 A、（A’+AB+B’D） B、（A’+B)(B’+C ‘） C、（C+B+B’C） D、（A’+B’）(A’+C)

答案: A’+AB+B’D

6、 已知函数 F（A,B,C,D）=(AB’)’+(C’D+B’C)’,则其最简表达式为（ ）。

答案: A’+B+C ‘D’

7、 逻辑函数 之间满足（ ）关系。

答案: 对偶 

8、 组合电路的竞争冒险是由于 引起的？

答案: 电路中存在延时

9、 一个电路在正逻辑中是两输入异或门，请问在负逻辑中是什么门？

答案: 同或门

10、 下列哪个说法正确？

答案: 同或门可以构成反相器

11、 Assume that each gate have a propagation delay of 5 ns. Which of the following statements is not correct

答案:  The hazard can be eliminated by adding (A+C+D)(A+B+C)

12、 一个根据最小成本设计实现的BCD码译码器，如果不允许输入大于9的数值的时候，当输入十进制数10时，输出为？

答案: 是一个数值，这个数值是固定的

13、 使用74HC138实现逻辑函数F = Õ (X,Y,Z) (2, 4, 5 )，正确的是

答案: Y2,Y4,Y5连与门

14、 以下哪些逻辑门组合，可以构成完备集（ complete set ）？

答案: 与门，非门;
或非门;
与非门

15、 下列哪种说法是错误的？

答案: 最小和一定比最小积电路更简单;
最小积是唯一的;
完全和等于最小和;
标准和一定不是最简电路

16、 下列哪种说法是错误的？

答案: 最小和一定是质主蕴含项之和;
标准和一定含有冒险

17、 卡诺图最小化电路的目的是什么

答案: Minimize number of AND gates;
Minimize number of OR gates;
Minimize number of inputs of AND gate;
Minimize number of inputs of OR gate;
Minimize Propagation delay from input to Output

18、 下列哪种方式能唯一的表述一个逻辑功能

答案: 真值表;
卡诺图;
标准积;
标准和

19、 F=?

答案: F=∑xyz（0，3，6，7）;
F= Õ xyz（1，2，4，5）

20、 如图所示电路论述正确的是

答案: 实现了P=B3⊕B2⊕B1⊕B0⊕1，校验电路是否输入偶数个1，当输入偶数个1时输出P=1;
实现了P=B3⊕B2⊕B1⊕B0⊕1，产生了奇校验位，如果连同P一起发送 B2B2B1B0P,发送了奇数个1

21、 两输入异或门与两输入同或门是相等关系？

答案: 错误
分析：偶数个输入的异或与同或是相反的关系，奇数个输入的异或与同或是相等关系

22、 质主蕴含项一定只含有1个奇异1单元？

答案: 错误
分析：一个质主蕴含项可以有多个奇异1单元

23、 缓冲器的输入加一个圈构成的电路，等效于一个反相器？

答案: 正确
分析：这个就是反相器的等效符号

24、 XOR and AND gate can not form a complete set.

答案: 错误
分析：XOR可以构成反相器，反相器和与门构成与非门，可以实现完备集。

25、 标准和、标准积、完全和是唯一的。

答案: 正确
分析：标准积是把一个电路输出为0的情况列出来，标准和是把一个电路输出为1的情况列出来，完全和是把一个卡诺图中的主蕴含项全部列出来。这三者均是唯一的。

26、 74×138最多可以实现3变量的任意逻辑函数

答案: 正确
分析：超过3变量，需要用到使能端，但是是特殊的逻辑函数，不能实现任意逻辑函数

27、 如图电路使用138和缓冲器实现了8选1的（ 选择器 ）

答案: 正确

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